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日本ケイデンス・デザイン・システムズ社

 

 

 

ケイデンスは、アーキテクチャ・レベルの開発からプロトタイピングまでのトータルフローをサポートするハードウェア/ソフトウェア協調開発プラットフォームSystem Development Suite (SDS)を業界に先駆けて2011年5月に発表しました。


SDSはSystemCを活用した仮想プロトタイピングのためのVirtual System Platform、トランザクションレベル/レジスタ転送レベル(RTL)/ゲートレベルの混在デザインの検証のためのFunctional Verification Platform、検証高速化を強力に推し進める Verification Computing Platform、早期のソフトウェア開発やシステム統合のための Rapid Prototyping Platformの4つのプラットフォームを統合しています。SDSでは、それぞれの開発フェーズで必要とされるaccuracyとperformanceのトレードオフを考慮しながら、最適な抽象度のモデルを取り扱うことができます。このようなトータルフローでは、複数の抽象度からなる開発プロセスをシームレスに結び付けることが必須ですが、トランザクションレベルとRTLのモデルを繋ぐ自動化ツールとして、高位合成が重要な位置を占めています。


ここでは、ケイデンスの高位合成ソリューションの特徴をご紹介します。

 
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